A very simple LogiSim CPU

hello-world-cpu.circ

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  <lib desc="#Wiring" name="0">
    <tool name="Pin">
      <a name="appearance" val="classic"/>
    </tool>
  </lib>
  <lib desc="#Gates" name="1">
    <tool name="AND Gate">
      <a name="size" val="30"/>
    </tool>
    <tool name="Controlled Buffer">
      <a name="width" val="8"/>
    </tool>
  </lib>
  <lib desc="#Plexers" name="2"/>
  <lib desc="#Arithmetic" name="3"/>
  <lib desc="#Memory" name="4"/>
  <lib desc="#I/O" name="5"/>
  <lib desc="#TTL" name="6"/>
  <lib desc="#TCL" name="7"/>
  <lib desc="#Base" name="8"/>
  <lib desc="#BFH-Praktika" name="9"/>
  <lib desc="#Input/Output-Extra" name="10"/>
  <lib desc="#Soc" name="11"/>
  <main name="main"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
  </options>
  <mappings>
    <tool lib="8" map="Button2" name="Poke Tool"/>
    <tool lib="8" map="Button3" name="Menu Tool"/>
    <tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="8" name="Poke Tool"/>
    <tool lib="8" name="Edit Tool"/>
    <tool lib="8" name="Wiring Tool"/>
    <tool lib="8" name="Text Tool"/>
    <sep/>
    <tool lib="0" name="Pin"/>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
    </tool>
    <sep/>
    <tool lib="1" name="NOT Gate"/>
    <tool lib="1" name="AND Gate"/>
    <tool lib="1" name="OR Gate"/>
    <tool lib="1" name="XOR Gate"/>
    <tool lib="1" name="NAND Gate"/>
    <tool lib="1" name="NOR Gate"/>
    <sep/>
    <tool lib="4" name="D Flip-Flop"/>
    <tool lib="4" name="Register"/>
  </toolbar>
  <circuit name="main">
    <a name="appearance" val="custom"/>
    <a name="circuit" val="main"/>
    <a name="circuitnamedboxfixedsize" val="true"/>
    <a name="simulationFrequency" val="2048000.0"/>
    <appear>
      <rect height="4" stroke="none" width="10" x="60" y="178"/>
      <text dominant-baseline="alphabetic" fill="#404040" font-family="Courier 10 Pitch" font-size="12" text-anchor="start" x="75" y="184">ROM_VALUE</text>
      <rect height="3" stroke="none" width="10" x="60" y="199"/>
      <text dominant-baseline="alphabetic" fill="#404040" font-family="Courier 10 Pitch" font-size="12" text-anchor="start" x="75" y="204">CLK</text>
      <rect height="3" stroke="none" width="10" x="60" y="219"/>
      <text dominant-baseline="alphabetic" fill="#404040" font-family="Courier 10 Pitch" font-size="12" text-anchor="start" x="75" y="224">RESET</text>
      <rect height="4" stroke="none" width="10" x="270" y="178"/>
      <text dominant-baseline="alphabetic" fill="#404040" font-family="Courier 10 Pitch" font-size="12" text-anchor="end" x="265" y="184">ROM_ADDR</text>
      <rect height="20" stroke="none" width="200" x="70" y="310"/>
      <rect fill="none" height="160" stroke="#000000" stroke-width="2" width="200" x="70" y="170"/>
      <text dominant-baseline="alphabetic" fill="#ffffff" font-family="Courier 10 Pitch" font-size="14" font-weight="bold" text-anchor="middle" x="171" y="323">main</text>
      <visible-register height="10" path="/Register(390,340)" stroke-width="0" width="13" x="90" y="250"/>
      <visible-register height="10" path="/Register(610,500)" stroke-width="0" width="13" x="90" y="290"/>
      <visible-register height="10" path="/Register(610,630)" stroke-width="0" width="13" x="110" y="290"/>
      <visible-register height="10" path="/Register(610,760)" stroke-width="0" width="13" x="130" y="290"/>
      <visible-counter height="10" path="/Counter(1090,510)" stroke-width="0" width="13" x="90" y="270"/>
      <visible-tty height="130" path="/TTY(1120,410)" stroke-width="0" width="234" x="49" y="40"/>
      <text dominant-baseline="central" font-family="SansSerif" font-size="12" text-anchor="middle" x="118" y="255">IMM</text>
      <text dominant-baseline="central" font-family="SansSerif" font-size="12" text-anchor="middle" x="113" y="275">PC</text>
      <text dominant-baseline="central" font-family="SansSerif" font-size="12" text-anchor="middle" x="160" y="295">REGS</text>
      <circ-anchor facing="east" x="280" y="180"/>
      <circ-port dir="in" pin="170,370" x="60" y="200"/>
      <circ-port dir="in" pin="170,400" x="60" y="220"/>
      <circ-port dir="in" pin="180,290" x="60" y="180"/>
      <circ-port dir="out" pin="1400,600" x="280" y="180"/>
    </appear>
    <comp lib="0" loc="(1040,390)" name="Splitter">
      <a name="appear" val="right"/>
      <a name="bit1" val="0"/>
      <a name="bit2" val="0"/>
      <a name="bit3" val="0"/>
      <a name="bit4" val="0"/>
      <a name="bit5" val="0"/>
      <a name="bit6" val="0"/>
      <a name="bit7" val="none"/>
      <a name="fanout" val="1"/>
      <a name="incoming" val="8"/>
    </comp>
    <comp lib="0" loc="(1080,500)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(1110,410)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="0" loc="(1130,480)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(1400,600)" name="Pin">
      <a name="appearance" val="classic"/>
      <a name="facing" val="west"/>
      <a name="label" val="ROM_ADDR"/>
      <a name="output" val="true"/>
      <a name="width" val="8"/>
    </comp>
    <comp lib="0" loc="(170,370)" name="Pin">
      <a name="appearance" val="classic"/>
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="0" loc="(170,400)" name="Pin">
      <a name="appearance" val="classic"/>
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(180,290)" name="Pin">
      <a name="appearance" val="classic"/>
      <a name="label" val="ROM_VALUE"/>
      <a name="width" val="8"/>
    </comp>
    <comp lib="0" loc="(180,370)" name="Tunnel">
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="0" loc="(180,400)" name="Tunnel">
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(240,290)" name="Splitter">
      <a name="fanout" val="8"/>
      <a name="incoming" val="8"/>
    </comp>
    <comp lib="0" loc="(250,360)" name="Splitter">
      <a name="appear" val="right"/>
      <a name="bit1" val="0"/>
      <a name="bit2" val="0"/>
      <a name="bit3" val="0"/>
      <a name="bit4" val="0"/>
      <a name="bit5" val="0"/>
      <a name="bit6" val="0"/>
      <a name="bit7" val="none"/>
      <a name="fanout" val="1"/>
      <a name="incoming" val="8"/>
    </comp>
    <comp lib="0" loc="(320,370)" name="Bit Extender">
      <a name="in_width" val="7"/>
      <a name="out_width" val="8"/>
      <a name="type" val="zero"/>
    </comp>
    <comp lib="0" loc="(380,410)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="0" loc="(410,440)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(600,570)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="0" loc="(600,700)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="0" loc="(600,830)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="0" loc="(630,600)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(630,730)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(630,860)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="RESET"/>
    </comp>
    <comp lib="0" loc="(820,300)" name="Bit Extender">
      <a name="in_width" val="1"/>
      <a name="out_width" val="8"/>
    </comp>
    <comp lib="0" loc="(850,520)" name="Splitter">
      <a name="fanout" val="8"/>
      <a name="incoming" val="8"/>
    </comp>
    <comp lib="0" loc="(910,370)" name="Splitter">
      <a name="bit7" val="none"/>
      <a name="fanout" val="7"/>
      <a name="incoming" val="8"/>
    </comp>
    <comp lib="0" loc="(980,590)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="CLK"/>
    </comp>
    <comp lib="1" loc="(1080,540)" name="OR Gate"/>
    <comp lib="1" loc="(400,560)" name="NOT Gate"/>
    <comp lib="1" loc="(540,810)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(550,310)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(550,550)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(550,680)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(600,430)" name="Controlled Buffer">
      <a name="facing" val="south"/>
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(730,530)" name="Controlled Buffer">
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(730,660)" name="Controlled Buffer">
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(730,790)" name="Controlled Buffer">
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(810,1030)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(810,950)" name="AND Gate">
      <a name="inputs" val="3"/>
      <a name="negate1" val="true"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(810,990)" name="AND Gate">
      <a name="inputs" val="3"/>
      <a name="negate1" val="true"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(880,320)" name="AND Gate">
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(910,740)" name="AND Gate">
      <a name="size" val="30"/>
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(950,690)" name="Controlled Buffer">
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(950,740)" name="Controlled Buffer">
      <a name="width" val="8"/>
    </comp>
    <comp lib="1" loc="(970,470)" name="AND Gate">
      <a name="inputs" val="9"/>
      <a name="negate1" val="true"/>
      <a name="negate2" val="true"/>
      <a name="negate3" val="true"/>
      <a name="negate4" val="true"/>
      <a name="negate5" val="true"/>
      <a name="negate6" val="true"/>
      <a name="negate7" val="true"/>
      <a name="negate8" val="true"/>
    </comp>
    <comp lib="3" loc="(920,690)" name="Adder"/>
    <comp lib="4" loc="(1090,510)" name="Counter">
      <a name="appearance" val="logisim_evolution"/>
    </comp>
    <comp lib="4" loc="(390,340)" name="Register">
      <a name="appearance" val="logisim_evolution"/>
      <a name="label" val="REG_IMM"/>
    </comp>
    <comp lib="4" loc="(610,500)" name="Register">
      <a name="appearance" val="logisim_evolution"/>
    </comp>
    <comp lib="4" loc="(610,630)" name="Register">
      <a name="appearance" val="logisim_evolution"/>
    </comp>
    <comp lib="4" loc="(610,760)" name="Register">
      <a name="appearance" val="logisim_evolution"/>
    </comp>
    <comp lib="5" loc="(1120,410)" name="TTY"/>
    <wire from="(1000,340)" to="(1000,760)"/>
    <wire from="(1020,300)" to="(1020,520)"/>
    <wire from="(1020,520)" to="(1030,520)"/>
    <wire from="(1060,400)" to="(1120,400)"/>
    <wire from="(1070,580)" to="(1070,620)"/>
    <wire from="(1070,620)" to="(1090,620)"/>
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    <wire from="(1080,460)" to="(1130,460)"/>
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    <wire from="(1130,420)" to="(1130,460)"/>
    <wire from="(1130,480)" to="(1140,480)"/>
    <wire from="(1140,420)" to="(1140,480)"/>
    <wire from="(1280,620)" to="(1290,620)"/>
    <wire from="(1290,600)" to="(1290,620)"/>
    <wire from="(1290,600)" to="(1400,600)"/>
    <wire from="(170,370)" to="(180,370)"/>
    <wire from="(170,400)" to="(180,400)"/>
    <wire from="(180,290)" to="(240,290)"/>
    <wire from="(240,290)" to="(240,360)"/>
    <wire from="(240,360)" to="(250,360)"/>
    <wire from="(260,210)" to="(480,210)"/>
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    <wire from="(260,230)" to="(460,230)"/>
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    <wire from="(260,250)" to="(500,250)"/>
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    <wire from="(320,370)" to="(390,370)"/>
    <wire from="(350,280)" to="(350,390)"/>
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    <wire from="(350,390)" to="(390,390)"/>
    <wire from="(350,560)" to="(370,560)"/>
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    <wire from="(410,1000)" to="(780,1000)"/>
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    <wire from="(410,820)" to="(510,820)"/>
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    <wire from="(460,230)" to="(460,800)"/>
    <wire from="(460,800)" to="(510,800)"/>
    <wire from="(470,220)" to="(470,670)"/>
    <wire from="(470,670)" to="(520,670)"/>
    <wire from="(480,210)" to="(480,540)"/>
    <wire from="(480,540)" to="(520,540)"/>
    <wire from="(500,250)" to="(500,320)"/>
    <wire from="(500,250)" to="(750,250)"/>
    <wire from="(500,320)" to="(520,320)"/>
    <wire from="(510,240)" to="(510,300)"/>
    <wire from="(510,240)" to="(740,240)"/>
    <wire from="(510,300)" to="(520,300)"/>
    <wire from="(540,810)" to="(610,810)"/>
    <wire from="(550,310)" to="(570,310)"/>
    <wire from="(550,550)" to="(610,550)"/>
    <wire from="(550,680)" to="(610,680)"/>
    <wire from="(560,460)" to="(560,530)"/>
    <wire from="(560,460)" to="(600,460)"/>
    <wire from="(560,530)" to="(560,660)"/>
    <wire from="(560,530)" to="(610,530)"/>
    <wire from="(560,660)" to="(560,790)"/>
    <wire from="(560,660)" to="(610,660)"/>
    <wire from="(560,790)" to="(610,790)"/>
    <wire from="(570,310)" to="(570,420)"/>
    <wire from="(570,420)" to="(570,950)"/>
    <wire from="(570,420)" to="(590,420)"/>
    <wire from="(570,950)" to="(720,950)"/>
    <wire from="(600,370)" to="(600,410)"/>
    <wire from="(600,370)" to="(810,370)"/>
    <wire from="(600,430)" to="(600,460)"/>
    <wire from="(600,460)" to="(780,460)"/>
    <wire from="(600,570)" to="(610,570)"/>
    <wire from="(600,700)" to="(610,700)"/>
    <wire from="(600,830)" to="(610,830)"/>
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