arch.xml

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<!-- set: ai sw=1 ts=1 sta et -->
<architecture xmlns:xi="http://www.w3.org/2001/XInclude">
  <models>
    <model name="dsp_combinational">
      <input_ports>
        <port combinational_sink_ports="out" name="a"/>
        <port combinational_sink_ports="out" name="b"/>
        <port combinational_sink_ports="out" name="m"/>
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      <output_ports>
        <port name="out"/>
      </output_ports>
    </model>
  </models>
  <complexblocklist>
    <!-- input buffer -->
    <pb_type name="IBUF">
      <output name="I" num_pins="1"/>
      <pb_type blif_model=".input" name="PIN" num_pb="1">
        <output name="inpad" num_pins="1"/>
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      <interconnect>
        <direct input="PIN.inpad" name="P" output="IBUF.I"/>
      </interconnect>
      <pinlocations pattern="custom">
        <loc side="right" xoffset="0" yoffset="0">IBUF.I</loc>
      </pinlocations>
    </pb_type>
    <!-- output buffer -->
    <pb_type name="OBUF">
      <input name="O" num_pins="1"/>
      <pb_type blif_model=".output" name="PIN" num_pb="1">
        <input name="outpad" num_pins="1"/>
      </pb_type>
      <interconnect>
        <direct input="OBUF.O" name="P" output="PIN.outpad"/>
      </interconnect>
      <pinlocations pattern="custom">
        <loc side="left" xoffset="0" yoffset="0">OBUF.O</loc>
      </pinlocations>
    </pb_type>
    <!-- pb_type.xml file will be included here -->
    <pb_type height="65" name="TILE" width="1">
      <pb_type blif_model=".subckt dsp_combinational" name="dsp_combinational" num_pb="1">
        <input name="a" num_pins="32"/>
        <input name="b" num_pins="32"/>
        <input name="m" num_pins="1"/>
        <output name="out" num_pins="64"/>
        <delay_constant in_port="dsp_combinational.a" max="30e-12" out_port="dsp_combinational.out"/>
        <delay_constant in_port="dsp_combinational.b" max="30e-12" out_port="dsp_combinational.out"/>
        <delay_constant in_port="dsp_combinational.m" max="10e-12" out_port="dsp_combinational.out"/>
      </pb_type>
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      <!--
   01234
 0 .....
 1 I.T.O
 2 I.T.O
 3 I.T.O
 4 I.T.O
 5 I.T.O
 6 I.T.O
 7 I.T.O
 8 I.T.O
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 19 I.T.O
 20 I.T.O
 21 I.T.O
 22 I.T.O
 23 I.T.O
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 35 I.T.O
 36 I.T.O
 37 I.T.O
 38 I.T.O
 39 I.T.O
 40 I.T.O
 41 I.T.O
 42 I.T.O
 43 I.T.O
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 50 I.T.O
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 65 I.T..
 66 .....
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    </fixed_layout>
  </layout>
  <device>
    <sizing R_minW_nmos="6065.520020" R_minW_pmos="18138.500000"/>
    <area grid_logic_tile_area="14813.392"/>
    <connection_block input_switch_name="mux"/>
    <switch_block fs="3" type="wilton"/>
    <chan_width_distr>
      <x distr="uniform" peak="1.000000"/>
      <y distr="uniform" peak="1.000000"/>
    </chan_width_distr>
    <default_fc in_type="frac" in_val="1.0" out_type="frac" out_val="1.0"/>
  </device>
  <switchlist>
    <switch Cin=".77e-15" Cout="4e-15" R="551" Tdel="58e-12" buf_size="27.645901" mux_trans_size="2.630740" name="mux" type="mux"/>
  </switchlist>
  <segmentlist>
    <segment Cmetal="22.5e-15" Rmetal="101" freq="1.000000" length="1" name="local" type="bidir">
      <sb type="pattern">1 1</sb>
      <cb type="pattern">1</cb>
      <wire_switch name="mux"/>
      <opin_switch name="mux"/>
    </segment>
  </segmentlist>
</architecture>

dsp_combinational.test.eblif

.model top
.inputs a0 a1 a2 a3 a4 a5 a6 a7 a8 a9 a10 a11 a12 a13 a14 a15 a16 a17 a18 a19 a20 a21 a22 a23 a24 a25 a26 a27 a28 a29 a30 a31 b0 b1 b2 b3 b4 b5 b6 b7 b8 b9 b10 b11 b12 b13 b14 b15 b16 b17 b18 b19 b20 b21 b22 b23 b24 b25 b26 b27 b28 b29 b30 b31 m
.outputs out0 out1 out2 out3 out4 out5 out6 out7 out8 out9 out10 out11 out12 out13 out14 out15 out16 out17 out18 out19 out20 out21 out22 out23 out24 out25 out26 out27 out28 out29 out30 out31 out32 out33 out34 out35 out36 out37 out38 out39 out40 out41 out42 out43 out44 out45 out46 out47 out48 out49 out50 out51 out52 out53 out54 out55 out56 out57 out58 out59 out60 out61 out62 out63
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.cname dsp_combinational
.end

vpr_stdout.log

VPR FPGA Placement and Routing.
Version: 8.0.0-dev+vpr-7.0.5-7049-g125359595
Revision: vpr-7.0.5-7049-g125359595
Compiled: 2019-05-06T16:09:44 (release build)
Compiler: GNU 7.3.0 on Linux-4.19.20-1rodete1-amd64 x86_64
University of Toronto
verilogtorouting.org
[email protected]
This is free open source code under MIT license.

VPR was run with the following command-line:
/usr/local/google/home/tansell/github/verilog-to-routing/vtr-verilog-to-routing/vpr/vpr /usr/local/google/home/tansell/github/SymbiFlow/symbiflow-arch-defs/build/utils/vlog/tests/dsp_combinational/dsp_combinational.arch.merged.xml /usr/local/google/home/tansell/github/SymbiFlow/symbiflow-arch-defs/build/utils/vlog/tests/dsp_combinational/dsp_combinational.test.eblif --echo_file on --pack --place --route --device device --target_ext_pin_util 1.0,1.0 --disp on

Using up to 1 parallel worker(s)

Architecture file: /usr/local/google/home/tansell/github/SymbiFlow/symbiflow-arch-defs/build/utils/vlog/tests/dsp_combinational/dsp_combinational.arch.merged.xml
Circuit name: dsp_combinational.test

# Loading Architecture Description
# Loading Architecture Description took 0.01 seconds (max_rss 8.0 MiB, delta_rss +2.1 MiB)
Warning 1: Non-zero switch output capacitance (4e-15) has no effect when switch 'mux' is used for connection block inputs
# Building complex block graph
# Building complex block graph took 0.01 seconds (max_rss 8.0 MiB, delta_rss +0.0 MiB)
# Load circuit
# Load circuit took 0.00 seconds (max_rss 8.6 MiB, delta_rss +0.6 MiB)
# Mark constant generators
Inferred    0 primitive pins as constant generators since they have no combinationally connected inputs
Inferred    0 primitive pins as constant generators due to constant inputs
# Mark constant generators took 0.00 seconds (max_rss 8.6 MiB, delta_rss +0.0 MiB)
# Clean circuit
Absorbing 0 LUT buffers
Swept input(s) : 0
Swept output(s): 0 (0 dangling, 0 constant)
Swept net(s)   : 0
Swept block(s) : 0
# Clean circuit took 0.00 seconds (max_rss 8.6 MiB, delta_rss +0.0 MiB)
# Compress circuit
# Compress circuit took 0.00 seconds (max_rss 8.6 MiB, delta_rss +0.0 MiB)
# Verify circuit
# Verify circuit took 0.00 seconds (max_rss 8.6 MiB, delta_rss +0.0 MiB)
Circuit Statistics:
  Blocks: 130
    .input           :      65
    .output          :      64
    dsp_combinational:       1
  Nets  : 129
    Avg Fanout:     1.0
    Max Fanout:     1.0
    Min Fanout:     1.0
  Netlist Clocks: 0
# Build Timing Graph
  Timing Graph Nodes: 258
  Timing Graph Edges: 4289
# Build Timing Graph took 0.00 seconds (max_rss 9.0 MiB, delta_rss +0.4 MiB)
Netlist contains 0 clocks
# Load Timing Constraints

SDC file 'dsp_combinational.test.sdc' not found
Setting default timing constraints:
   * constrain all primay inputs and primary outputs on a virtual external clock 'virtual_io_clock'
   * optimize virtual clock to run as fast as possible
Timing constraints created 1 clocks
  Constrained Clock 'virtual_io_clock' (Virtual Clock)

# Load Timing Constraints took 0.00 seconds (max_rss 9.3 MiB, delta_rss +0.3 MiB)
Timing analysis: ON
Slack definition: 
Circuit netlist file: dsp_combinational.test.net
Circuit placement file: dsp_combinational.test.place
Circuit routing file: dsp_combinational.test.route
Circuit SDC file: dsp_combinational.test.sdc

Packer: ENABLED
Placer: ENABLED
Router: ENABLED
Analysis: ENABLED

NetlistOpts.abosrb_buffer_luts            : true
NetlistOpts.sweep_dangling_primary_ios    : true
NetlistOpts.sweep_dangling_nets           : true
NetlistOpts.sweep_dangling_blocks         : true
NetlistOpts.sweep_constant_primary_outputs: false

PackerOpts.allow_unrelated_clustering: auto
PackerOpts.alpha_clustering: 0.750000
PackerOpts.beta_clustering: 0.900000
PackerOpts.cluster_seed_type: BLEND2
PackerOpts.connection_driven: true
PackerOpts.global_clocks: true
PackerOpts.hill_climbing_flag: false
PackerOpts.inter_cluster_net_delay: 1.000000
PackerOpts.timing_driven: true
PackerOpts.target_external_pin_util: 1.0,1.0
PlacerOpts.place_freq: PLACE_ONCE
PlacerOpts.place_algorithm: PATH_TIMING_DRIVEN_PLACE
PlacerOpts.pad_loc_type: FREE
PlacerOpts.place_cost_exp: 1.000000
PlacerOpts.place_chan_width: 100
PlacerOpts.inner_loop_recompute_divider: 0
PlacerOpts.recompute_crit_iter: 1
PlacerOpts.timing_tradeoff: 0.500000
PlacerOpts.td_place_exp_first: 1.000000
PlacerOpts.td_place_exp_last: 8.000000
PlaceOpts.seed: 1
AnnealSched.type: AUTO_SCHED
AnnealSched.inner_num: 1.000000

RouterOpts.route_type: DETAILED
RouterOpts.router_algorithm: TIMING_DRIVEN
RouterOpts.base_cost_type: DELAY_NORMALIZED_LENGTH
RouterOpts.fixed_channel_width: NO_FIXED_CHANNEL_WIDTH
RouterOpts.trim_empty_chan: false
RouterOpts.trim_obs_chan: false
RouterOpts.acc_fac: 1.000000
RouterOpts.bb_factor: 3
RouterOpts.bend_cost: 0.000000
RouterOpts.first_iter_pres_fac: 0.000000
RouterOpts.initial_pres_fac: 0.500000
RouterOpts.pres_fac_mult: 1.300000
RouterOpts.max_router_iterations: 50
RouterOpts.min_incremental_reroute_fanout: 16
RouterOpts.astar_fac: 1.200000
RouterOpts.criticality_exp: 1.000000
RouterOpts.max_criticality: 0.990000
RouterOpts.routing_failure_predictor = SAFE
RouterOpts.routing_budgets_algorithm = DISABLE

AnalysisOpts.gen_post_synthesis_netlist: false

RoutingArch.directionality: BI_DIRECTIONAL
RoutingArch.switch_block_type: WILTON
RoutingArch.Fs: 3

# Packing
Begin packing '/usr/local/google/home/tansell/github/SymbiFlow/symbiflow-arch-defs/build/utils/vlog/tests/dsp_combinational/dsp_combinational.test.eblif'.

After removing unused inputs...
	total blocks: 130, total nets: 129, total inputs: 65, total outputs: 64
Begin prepacking.
Finish prepacking.
Using inter-cluster delay: 1.2887e-09
Packing with pin utilization targets: IBUF:1,1 OBUF:1,1 TILE:1,1
Not enough resources expand FPGA size to (5 x 67)
Complex block 0: dsp_combinational, type: TILE .
Complex block 1: out:out17, type: OBUF .
Complex block 2: out:out31, type: OBUF .
Complex block 3: out:out18, type: OBUF .
Complex block 4: out:out19, type: OBUF .
Complex block 5: out:out20, type: OBUF .
Complex block 6: out:out21, type: OBUF .
Complex block 7: out:out22, type: OBUF .
Complex block 8: out:out23, type: OBUF .
Complex block 9: out:out24, type: OBUF .
Complex block 10: out:out25, type: OBUF .
Complex block 11: out:out26, type: OBUF .
Complex block 12: out:out27, type: OBUF .
Complex block 13: out:out28, type: OBUF .
Complex block 14: out:out29, type: OBUF .
Complex block 15: out:out30, type: OBUF .
Complex block 16: out:out1, type: OBUF .
Complex block 17: out:out16, type: OBUF .
Complex block 18: out:out15, type: OBUF .
Complex block 19: out:out14, type: OBUF .
Complex block 20: out:out13, type: OBUF .
Complex block 21: out:out12, type: OBUF .
Complex block 22: out:out11, type: OBUF .
Complex block 23: out:out10, type: OBUF .
Complex block 24: out:out9, type: OBUF .
Complex block 25: out:out8, type: OBUF .
Complex block 26: out:out7, type: OBUF .
Complex block 27: out:out6, type: OBUF .
Complex block 28: out:out5, type: OBUF .
Complex block 29: out:out4, type: OBUF .
Complex block 30: out:out3, type: OBUF .
Complex block 31: out:out2, type: OBUF .
Complex block 32: out:out0, type: OBUF .
Complex block 33: out:out48, type: OBUF .
Complex block 34: out:out63, type: OBUF .
Complex block 35: out:out62, type: OBUF .
Complex block 36: out:out61, type: OBUF .
Complex block 37: out:out60, type: OBUF .
Complex block 38: out:out59, type: OBUF .
Complex block 39: out:out58, type: OBUF .
Complex block 40: out:out57, type: OBUF .
Complex block 41: out:out56, type: OBUF .
Complex block 42: out:out55, type: OBUF .
Complex block 43: out:out54, type: OBUF .
Complex block 44: out:out53, type: OBUF .
Complex block 45: out:out52, type: OBUF .
Complex block 46: out:out51, type: OBUF .
Complex block 47: out:out50, type: OBUF .
Complex block 48: out:out49, type: OBUF .
Complex block 49: out:out32, type: OBUF .
Complex block 50: out:out47, type: OBUF .
Complex block 51: out:out46, type: OBUF .
Complex block 52: out:out45, type: OBUF .
Complex block 53: out:out44, type: OBUF .
Complex block 54: out:out43, type: OBUF .
Complex block 55: out:out42, type: OBUF .
Complex block 56: out:out41, type: OBUF .
Complex block 57: out:out40, type: OBUF .
Complex block 58: out:out39, type: OBUF .
Complex block 59: out:out38, type: OBUF .
Complex block 60: out:out37, type: OBUF .
Complex block 61: out:out36, type: OBUF .
Complex block 62: out:out35, type: OBUF .
Complex block 63: out:out34, type: OBUF .
Complex block 64: out:out33, type: OBUF .
Complex block 65: a25, type: IBUF .
Complex block 66: a17, type: IBUF .
Complex block 67: a18, type: IBUF .
Complex block 68: a19, type: IBUF .
Complex block 69: a20, type: IBUF .
Complex block 70: a21, type: IBUF .
Complex block 71: a22, type: IBUF .
Complex block 72: a23, type: IBUF .
Complex block 73: a24, type: IBUF .
Complex block 74: a16, type: IBUF .
Complex block 75: a26, type: IBUF .
Complex block 76: a27, type: IBUF .
Complex block 77: a28, type: IBUF .
Complex block 78: a29, type: IBUF .
Complex block 79: a30, type: IBUF .
Complex block 80: a31, type: IBUF .
Complex block 81: b0, type: IBUF .
Complex block 82: b1, type: IBUF .
Complex block 83: a15, type: IBUF .
Complex block 84: a14, type: IBUF .
Complex block 85: a13, type: IBUF .
Complex block 86: a12, type: IBUF .
Complex block 87: a11, type: IBUF .
Complex block 88: a10, type: IBUF .
Complex block 89: a9, type: IBUF .
Complex block 90: a8, type: IBUF .
Complex block 91: a7, type: IBUF .
Complex block 92: a6, type: IBUF .
Complex block 93: a5, type: IBUF .
Complex block 94: a4, type: IBUF .
Complex block 95: a3, type: IBUF .
Complex block 96: a2, type: IBUF .
Complex block 97: a1, type: IBUF .
Complex block 98: b17, type: IBUF .
Complex block 99: m, type: IBUF .
Complex block 100: b31, type: IBUF .
Complex block 101: b30, type: IBUF .
Complex block 102: b29, type: IBUF .
Complex block 103: b28, type: IBUF .
Complex block 104: b27, type: IBUF .
Complex block 105: b26, type: IBUF .
Complex block 106: b25, type: IBUF .
Complex block 107: b24, type: IBUF .
Complex block 108: b23, type: IBUF .
Complex block 109: b22, type: IBUF .
Complex block 110: b21, type: IBUF .
Complex block 111: b20, type: IBUF .
Complex block 112: b19, type: IBUF .
Complex block 113: b18, type: IBUF .
Complex block 114: a0, type: IBUF .
Complex block 115: b16, type: IBUF .
Complex block 116: b15, type: IBUF .
Complex block 117: b14, type: IBUF .
Complex block 118: b13, type: IBUF .
Complex block 119: b12, type: IBUF .
Complex block 120: b11, type: IBUF .
Complex block 121: b10, type: IBUF .
Complex block 122: b9, type: IBUF .
Complex block 123: b8, type: IBUF .
Complex block 124: b7, type: IBUF .
Complex block 125: b6, type: IBUF .
Complex block 126: b5, type: IBUF .
Complex block 127: b4, type: IBUF .
Complex block 128: b3, type: IBUF .
Complex block 129: b2, type: IBUF .
	EMPTY: # blocks: 0, average # input + clock pins used: 0, average # output pins used: 0
	IBUF: # blocks: 65, average # input + clock pins used: 0, average # output pins used: 1
	OBUF: # blocks: 64, average # input + clock pins used: 1, average # output pins used: 0
	TILE: # blocks: 1, average # input + clock pins used: 65, average # output pins used: 64
Absorbed logical nets 0 out of 129 nets, 129 nets not absorbed.
FPGA sized to 5 x 67 (device)
Device Utilization: 0.58 (target 1.00)
	Block Utilization: 1.00 Type: IBUF
	Block Utilization: 1.00 Type: OBUF
	Block Utilization: 1.00 Type: TILE


Netlist conversion complete.

# Packing took 0.04 seconds (max_rss 9.9 MiB, delta_rss +0.6 MiB)
# Load Packing
Begin loading packed FPGA netlist file.
Netlist generated from file 'dsp_combinational.test.net'.
Finished loading packed FPGA netlist file (took 0.006219 seconds).
# Load Packing took 0.01 seconds (max_rss 11.7 MiB, delta_rss +1.9 MiB)
Warning 2: Netlist contains 0 global net to non-global architecture pin connections
Warning 3: Logic block #65 (a25) has only 1 input pin 'a25.I' -- the whole block is hanging logic that should be swept.
Warning 4: Logic block #66 (a17) has only 1 input pin 'a17.I' -- the whole block is hanging logic that should be swept.
Warning 5: Logic block #67 (a18) has only 1 input pin 'a18.I' -- the whole block is hanging logic that should be swept.
Warning 6: Logic block #68 (a19) has only 1 input pin 'a19.I' -- the whole block is hanging logic that should be swept.
Warning 7: Logic block #69 (a20) has only 1 input pin 'a20.I' -- the whole block is hanging logic that should be swept.
Warning 8: Logic block #70 (a21) has only 1 input pin 'a21.I' -- the whole block is hanging logic that should be swept.
Warning 9: Logic block #71 (a22) has only 1 input pin 'a22.I' -- the whole block is hanging logic that should be swept.
Warning 10: Logic block #72 (a23) has only 1 input pin 'a23.I' -- the whole block is hanging logic that should be swept.
Warning 11: Logic block #73 (a24) has only 1 input pin 'a24.I' -- the whole block is hanging logic that should be swept.
Warning 12: Logic block #74 (a16) has only 1 input pin 'a16.I' -- the whole block is hanging logic that should be swept.
Warning 13: Logic block #75 (a26) has only 1 input pin 'a26.I' -- the whole block is hanging logic that should be swept.
Warning 14: Logic block #76 (a27) has only 1 input pin 'a27.I' -- the whole block is hanging logic that should be swept.
Warning 15: Logic block #77 (a28) has only 1 input pin 'a28.I' -- the whole block is hanging logic that should be swept.
Warning 16: Logic block #78 (a29) has only 1 input pin 'a29.I' -- the whole block is hanging logic that should be swept.
Warning 17: Logic block #79 (a30) has only 1 input pin 'a30.I' -- the whole block is hanging logic that should be swept.
Warning 18: Logic block #80 (a31) has only 1 input pin 'a31.I' -- the whole block is hanging logic that should be swept.
Warning 19: Logic block #81 (b0) has only 1 input pin 'b0.I' -- the whole block is hanging logic that should be swept.
Warning 20: Logic block #82 (b1) has only 1 input pin 'b1.I' -- the whole block is hanging logic that should be swept.
Warning 21: Logic block #83 (a15) has only 1 input pin 'a15.I' -- the whole block is hanging logic that should be swept.
Warning 22: Logic block #84 (a14) has only 1 input pin 'a14.I' -- the whole block is hanging logic that should be swept.
Warning 23: Logic block #85 (a13) has only 1 input pin 'a13.I' -- the whole block is hanging logic that should be swept.
Warning 24: Logic block #86 (a12) has only 1 input pin 'a12.I' -- the whole block is hanging logic that should be swept.
Warning 25: Logic block #87 (a11) has only 1 input pin 'a11.I' -- the whole block is hanging logic that should be swept.
Warning 26: Logic block #88 (a10) has only 1 input pin 'a10.I' -- the whole block is hanging logic that should be swept.
Warning 27: Logic block #89 (a9) has only 1 input pin 'a9.I' -- the whole block is hanging logic that should be swept.
Warning 28: Logic block #90 (a8) has only 1 input pin 'a8.I' -- the whole block is hanging logic that should be swept.
Warning 29: Logic block #91 (a7) has only 1 input pin 'a7.I' -- the whole block is hanging logic that should be swept.
Warning 30: Logic block #92 (a6) has only 1 input pin 'a6.I' -- the whole block is hanging logic that should be swept.
Warning 31: Logic block #93 (a5) has only 1 input pin 'a5.I' -- the whole block is hanging logic that should be swept.
Warning 32: Logic block #94 (a4) has only 1 input pin 'a4.I' -- the whole block is hanging logic that should be swept.
Warning 33: Logic block #95 (a3) has only 1 input pin 'a3.I' -- the whole block is hanging logic that should be swept.
Warning 34: Logic block #96 (a2) has only 1 input pin 'a2.I' -- the whole block is hanging logic that should be swept.
Warning 35: Logic block #97 (a1) has only 1 input pin 'a1.I' -- the whole block is hanging logic that should be swept.
Warning 36: Logic block #98 (b17) has only 1 input pin 'b17.I' -- the whole block is hanging logic that should be swept.
Warning 37: Logic block #99 (m) has only 1 input pin 'm.I' -- the whole block is hanging logic that should be swept.
Warning 38: Logic block #100 (b31) has only 1 input pin 'b31.I' -- the whole block is hanging logic that should be swept.
Warning 39: Logic block #101 (b30) has only 1 input pin 'b30.I' -- the whole block is hanging logic that should be swept.
Warning 40: Logic block #102 (b29) has only 1 input pin 'b29.I' -- the whole block is hanging logic that should be swept.
Warning 41: Logic block #103 (b28) has only 1 input pin 'b28.I' -- the whole block is hanging logic that should be swept.
Warning 42: Logic block #104 (b27) has only 1 input pin 'b27.I' -- the whole block is hanging logic that should be swept.
Warning 43: Logic block #105 (b26) has only 1 input pin 'b26.I' -- the whole block is hanging logic that should be swept.
Warning 44: Logic block #106 (b25) has only 1 input pin 'b25.I' -- the whole block is hanging logic that should be swept.
Warning 45: Logic block #107 (b24) has only 1 input pin 'b24.I' -- the whole block is hanging logic that should be swept.
Warning 46: Logic block #108 (b23) has only 1 input pin 'b23.I' -- the whole block is hanging logic that should be swept.
Warning 47: Logic block #109 (b22) has only 1 input pin 'b22.I' -- the whole block is hanging logic that should be swept.
Warning 48: Logic block #110 (b21) has only 1 input pin 'b21.I' -- the whole block is hanging logic that should be swept.
Warning 49: Logic block #111 (b20) has only 1 input pin 'b20.I' -- the whole block is hanging logic that should be swept.
Warning 50: Logic block #112 (b19) has only 1 input pin 'b19.I' -- the whole block is hanging logic that should be swept.
Warning 51: Logic block #113 (b18) has only 1 input pin 'b18.I' -- the whole block is hanging logic that should be swept.
Warning 52: Logic block #114 (a0) has only 1 input pin 'a0.I' -- the whole block is hanging logic that should be swept.
Warning 53: Logic block #115 (b16) has only 1 input pin 'b16.I' -- the whole block is hanging logic that should be swept.
Warning 54: Logic block #116 (b15) has only 1 input pin 'b15.I' -- the whole block is hanging logic that should be swept.
Warning 55: Logic block #117 (b14) has only 1 input pin 'b14.I' -- the whole block is hanging logic that should be swept.
Warning 56: Logic block #118 (b13) has only 1 input pin 'b13.I' -- the whole block is hanging logic that should be swept.
Warning 57: Logic block #119 (b12) has only 1 input pin 'b12.I' -- the whole block is hanging logic that should be swept.
Warning 58: Logic block #120 (b11) has only 1 input pin 'b11.I' -- the whole block is hanging logic that should be swept.
Warning 59: Logic block #121 (b10) has only 1 input pin 'b10.I' -- the whole block is hanging logic that should be swept.
Warning 60: Logic block #122 (b9) has only 1 input pin 'b9.I' -- the whole block is hanging logic that should be swept.
Warning 61: Logic block #123 (b8) has only 1 input pin 'b8.I' -- the whole block is hanging logic that should be swept.
Warning 62: Logic block #124 (b7) has only 1 input pin 'b7.I' -- the whole block is hanging logic that should be swept.
Warning 63: Logic block #125 (b6) has only 1 input pin 'b6.I' -- the whole block is hanging logic that should be swept.
Warning 64: Logic block #126 (b5) has only 1 input pin 'b5.I' -- the whole block is hanging logic that should be swept.
Warning 65: Logic block #127 (b4) has only 1 input pin 'b4.I' -- the whole block is hanging logic that should be swept.
Warning 66: Logic block #128 (b3) has only 1 input pin 'b3.I' -- the whole block is hanging logic that should be swept.
Warning 67: Logic block #129 (b2) has only 1 input pin 'b2.I' -- the whole block is hanging logic that should be swept.

Netlist num_nets: 129
Netlist num_blocks: 130
Netlist EMPTY blocks: 0.
Netlist IBUF blocks: 65.
Netlist OBUF blocks: 64.
Netlist TILE blocks: 1.
Netlist inputs pins: 65
Netlist output pins: 64

# Create Device
## Build Device Grid
FPGA sized to 5 x 67: 335 grid tiles (device)

Resource usage...
	Netlist      0	blocks of type: EMPTY
	Architecture 0	blocks of type: EMPTY
	Netlist      65	blocks of type: IBUF
	Architecture 65	blocks of type: IBUF
	Netlist      64	blocks of type: OBUF
	Architecture 64	blocks of type: OBUF
	Netlist      1	blocks of type: TILE
	Architecture 1	blocks of type: TILE

Device Utilization: 0.58 (target 1.00)
	Block Utilization: 0.00 Type: EMPTY
	Block Utilization: 1.00 Type: IBUF
	Block Utilization: 1.00 Type: OBUF
	Block Utilization: 1.00 Type: TILE

## Build Device Grid took 0.00 seconds (max_rss 16.0 MiB, delta_rss +0.0 MiB)
## Build routing resource graph